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本文給出了一種采用Altera公司的Cyclone系列EP1C12Q240C8的FPGA芯片設(shè)計磁盤陣列校驗卡的硬件電路的方法。該設(shè)計采用了并行的思想,令數(shù)據(jù)在PCI總線上的傳輸過程和校驗計算過程在時間上重疊,使得整個校驗過程耗費的時間等同于數(shù)據(jù)在總線上傳輸?shù)臅r間,從而最大限度地提高了校驗性能。設(shè)計經(jīng)軟件仿真和硬件實現(xiàn),結(jié)果表明電路性能可靠。
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