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更新時(shí)間：2024.12.22
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針對(duì)鎖相環(huán)頻率合成器工程設(shè)計(jì)中的問題,對(duì)鎖相環(huán)參考頻率輸入端的饋電電路提出改進(jìn)措施,增強(qiáng)了鎖相環(huán)參考頻率信號(hào)的輸入功率,為提高相位噪聲性能創(chuàng)造了有利條件。對(duì)傳統(tǒng)的VCO輸出T型電阻功率分配網(wǎng)絡(luò)進(jìn)行改進(jìn),減小了因功率過多分配給鎖相環(huán)反饋支路所造成的損失,最大限度地把VCO的功率分配給端口負(fù)載。并給出了鎖相環(huán)頻率合成器在多頻點(diǎn)和單頻點(diǎn)信號(hào)輸出時(shí)分頻器的通用配置方法。實(shí)驗(yàn)驗(yàn)證該理論分析和設(shè)計(jì)方法的正確性。
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為了提高反熔絲FPGA芯片分頻電路的系統(tǒng)工作頻率,針對(duì)ACTEL公司提供的反熔絲芯片A32100DX,提出了基于計(jì)數(shù)器、移位寄存器與狀態(tài)機(jī)的分頻器VHDL編程方法,給出了硬件開發(fā)設(shè)計(jì)流程及3種設(shè)計(jì)方法的源程序,并對(duì)采用局部時(shí)鐘及全局時(shí)鐘、同步復(fù)位、異步復(fù)位、以及復(fù)位置零的計(jì)數(shù)器法在高低溫環(huán)境下進(jìn)行了后仿真對(duì)比分析,后仿真對(duì)比及燒寫后的實(shí)測(cè)結(jié)果表明同步復(fù)位的移位寄存器分頻方法后仿真速度最高,但在燒寫后工作的可靠性不高,容易出現(xiàn)無輸出現(xiàn)象,采用全局時(shí)鐘且同步復(fù)位清零的計(jì)數(shù)器法速度較高,且工作可靠,已經(jīng)在型號(hào)設(shè)計(jì)中采用。
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