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降低功耗已成為超大規(guī)模集成電路的一個重要發(fā)展方向,而降低電源電壓(目前Vdd=1.8V甚至更低)是一種很有效的降低功耗的方法。而在非揮發(fā)性存儲器電路中,為了能夠?qū)?shù)據(jù)保持10年以上,
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電子線路課程設(shè)計(jì)總結(jié) 題目: 集成直流穩(wěn)壓電路 學(xué) 院: 電子工程學(xué)院 專 業(yè): 電子信息工程 學(xué) 號: 200912701035 姓 名: 陽長富 指導(dǎo)教師: 黃國現(xiàn) 2010年 12 月 20日 <<電子線路課程設(shè)計(jì) >>總結(jié) 專業(yè): 電子信息工程 學(xué)號: 200912701035 姓名:陽長富 一、設(shè)計(jì)電路原理圖及工作原理 1、電路原理圖: R1 2 40 R2 2 K Q1 A1 015 RW 5K + C1 4 700 uF 3 5 V + C3 10u F50 V + C4 10uF50 V + C5 1 0uF50 V C2 0.1 uF VDi VDo 集成直流穩(wěn)壓電路原理圖 ~15 V D1 IN4 0 07 D2 IN4 007 D4 IN4 007 D3 IN4 0 07 D5 IN4 007 D6 IN4 0 07 1 2 J1 IN 1 2 J
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