數(shù)字邏輯與數(shù)字集成電路(第2版)圖書信息

作者:王爾乾ISBN:

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第1章數(shù)制和編碼1

1.1數(shù)制1

1.1.1二進制1

1.1.2八進制2

1.1.3十六進制2

1.1.4二進制與八進制、十六進制之間的轉(zhuǎn)換2

1.1.5二進制與十進制之間的轉(zhuǎn)換3

1.2編碼5

1.2.1帶符號的二進制數(shù)的編碼5

1.2.2帶小數(shù)點的數(shù)的編碼8

1.2.3十進制數(shù)的二進制編碼10

1.2.4格雷碼11

1.2.5字符編碼12

習題13第2章邏輯代數(shù)及邏輯函數(shù)的化簡15

2.1邏輯代數(shù)的基本原理15

2.1.1邏輯代數(shù)的基本運算15

2.1.2邏輯代數(shù)的基本公式、規(guī)則、附加公式16

2.1.3基本邏輯電路20

2.2邏輯函數(shù)的化簡

習題51第3章集成門電路與觸發(fā)器55

3.1集成邏輯電路的分類55

3.2正邏輯和負邏輯的概念56

3.3TTL門電路

3.4觸發(fā)器70

3.4.1基本R\|S觸發(fā)器70

3.4.2電位觸發(fā)方式的觸發(fā)器71

3.4.3邊沿觸發(fā)方式的觸發(fā)器73

3.4.4比較電位觸發(fā)器和邊沿觸發(fā)器76

3.4.5主\|從觸發(fā)方式的觸發(fā)器77

3.5觸發(fā)器的開關(guān)特性及時鐘偏移81

3.6TTL系列86

習題90第4章組合邏輯電路101

4.1譯碼器101

4.1.1變量譯碼器101

4.1.2碼制變換譯碼器110

4.1.3顯示譯碼器114

4.2數(shù)據(jù)選擇器117

4.2.1原理117

4.2.2常見的數(shù)據(jù)選擇器118

4.2.3數(shù)據(jù)選擇器的應用120

4.3編碼器125

4.4數(shù)字比較器127

4.4.1并行比較器的原理127

4.4.2"分段比較"的原理129

4.5算術(shù)邏輯運算單元131

4.5.1一位加法器131

4.5.24位串行進位加法器133

4.5.34位并行進位加法器134

4.5.416位并行進位加法器138

4.5.6超前進位擴展器146

4.6奇偶檢測電路148

4.6.1原理148

4.6.2奇偶檢測電路149

4.6.3奇偶檢測電路的應用和擴展150

4.7組合邏輯電路中的競爭和險象151

4.8集成化組合邏輯電路的開關(guān)參數(shù)154

4.8.1譯碼器的開關(guān)參數(shù)154

4.8.2數(shù)據(jù)選擇器的開關(guān)參數(shù)154

4.8.3算術(shù)邏輯運算單元的開關(guān)參數(shù)155

4.9組合邏輯電路的測試155

習題158第5章同步時序電路166

5.1同步時序電路的結(jié)構(gòu)166

5.2激勵表、狀態(tài)表及狀態(tài)圖168

5.3同步時序電路的分析170

5.4同步時序電路的設(shè)計173

5.4.1原始狀態(tài)表的構(gòu)成174

5.4.2狀態(tài)表的簡化175

5.4.3狀態(tài)分配、求激勵函數(shù)與輸出函數(shù)180

5.4.4不完全確定狀態(tài)的同步時序電路的設(shè)計181

5.4.5設(shè)計舉例184

5.5集成化的同步時序電路188

5.5.1寄存器188

5.5.2移位寄存器194

5.5.3寄存器和移位寄存器的應用201

5.5.4同步計數(shù)器206

5.6同步時序電路的測試223

習題225第6章異步時序電路236

6.1脈沖異步電路236

6.1.1脈沖異步電路的分析與設(shè)計236

6.1.2集成化的脈沖異步電路239

6.2電位異步電路243

6.2.1電位異步電路的分析244

6.2.2電位異步電路的設(shè)計245

6.3異步時序電路的競爭與冒險現(xiàn)象250

6.3.1競爭現(xiàn)象250

6.3.2冒險現(xiàn)象253

習題255第7章可編程邏輯電路258

7.1只讀存儲器259

7.2可編程序邏輯陣列266

7.3可編程序陣列邏輯275

7.4通用陣列邏輯279

7.5可編程門陣列285

習題290參考文獻293