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設(shè)計了一款具有4級流水線結(jié)構(gòu)的16位RISC嵌入式微處理器。針對轉(zhuǎn)移指令,未采用慣用的延遲轉(zhuǎn)移技術(shù),而是通過在取指階段增加相應(yīng)的硬件結(jié)構(gòu)實現(xiàn)了無延遲轉(zhuǎn)移。采用內(nèi)部前推技術(shù)解決了指令執(zhí)行過程中的數(shù)據(jù)相關(guān)。同時通過設(shè)置相應(yīng)的硬件堆棧實現(xiàn)了對中斷嵌套和調(diào)用嵌套的支持。整體系統(tǒng)結(jié)構(gòu)采用VerilogHDL語言設(shè)計,指令系統(tǒng)較完善。在軟件平臺上的仿真驗證初步表明了本設(shè)計的正確性。
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網(wǎng)絡(luò)數(shù)字視頻監(jiān)控系統(tǒng)目前主要采用IP解碼矩陣將大量的IP視頻信號輸出到監(jiān)控中心的電視墻上,而IP解碼矩陣大都采用工控機加板卡方式實現(xiàn),其可靠性和穩(wěn)定性都比較差.針對該問題,詳細(xì)介紹基于嵌入式網(wǎng)絡(luò)虛擬音視頻矩陣的硬件設(shè)計和實現(xiàn),并分析其性能指標(biāo).在輪跳切換時采用一定策略解決切換黑屏問題;在網(wǎng)絡(luò)延時和突發(fā)處理中運用彈性緩存機制,有效改善圖像播放不流暢和延時現(xiàn)象.與工控機模式的網(wǎng)絡(luò)矩陣相比,其先進性和實用性較好.
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