第1章EDA技術(shù)概述

1.1 EDA技術(shù)及其發(fā)展歷程

1.2 EDA技術(shù)的特征和優(yōu)勢

1.2.1 EDA技術(shù)的基本特征

1.2.2 EDA技術(shù)的優(yōu)勢

1.3 EDA設(shè)計的目標(biāo)和流程

1.3.1 EDA技術(shù)的實現(xiàn)目標(biāo)

1.3.2 EDA設(shè)計流程

1.3.3 數(shù)字集成電路的設(shè)計

1.3.4 模擬集成電路的設(shè)計

1.4 EDA技術(shù)與ASIC設(shè)計

1.4.1 ASIC的特點與分類

1.4.2 ASIC的設(shè)計方法

1.4.3 SoC設(shè)計

1.5硬件描述語言

1.5.1 VHDI

1.5.2 VerilogHDL

1.5.3 ABEL-HDL

1.5.4 Verilog HDL和VHDL的比較

1.6 EDA設(shè)計工具

1.6.1 EDA設(shè)計工具分類

1.6.2 EDA公司與工具介紹

1.7 EDA技術(shù)的發(fā)展趨勢

習(xí)題1

第2章可編程邏輯器件基礎(chǔ)

2.1 概述

2.1.1 可編程邏輯器件發(fā)展歷程

2.1.2 可編程邏輯器件分類

2.1.3 可編程邏輯器件的優(yōu)勢

2.1.4 可編程邏輯器件的發(fā)展趨勢

2.2 PLD器件的基本結(jié)構(gòu)

2.2.1 基本結(jié)構(gòu)

2.2.2 電路符號

2.2.4 PLA

2.2.5 PAL

2.2.6 GAL

2.3 CPLD/PPGA的結(jié)構(gòu)特點

2.3.1 Lauice公司的CPLD/FPGA

2.3.2 Xilinx公司的CPLD/FPGA

2.3.3 Altera和Acrel公司的CPLD/FPGA

2.3.4 CPLD和FPGA的異同

2.4 可編程邏輯器件的基本資源

2.4.1 功能單元

2.4.2 輸入一輸出焊盤

2.4.3 布線資源

2.4.4 片內(nèi)RAM

2.5 可編程邏輯器件的編程器件

2.5.1 熔絲型開關(guān)

2.5.2 反熔絲型開關(guān)

2.5.3 浮柵編程器件

2.5.4 基于SRAM的編程器件

2.6 可編程邏輯器件的設(shè)計與開發(fā)

2.6.1 CPLD/FPGA設(shè)計流程

2.6.2 CPLD/FPGA開發(fā)工具

2.6.3 CPLD/FPGA的應(yīng)用選擇

2.7 可編程邏輯器件的測試技術(shù)

2.7.1 邊界掃描測試原理

2.7.2 IEEE 1149.1標(biāo)準(zhǔn)

2.7.3 邊界掃描策略及相關(guān)工具

習(xí)題2

第3章典型FPGA/CPLD的結(jié)構(gòu)與配置

3.1 Stratix高端FPGA系列

3.1.1 Stratix器件

3.1.2 StratixⅡ器件

3.2 Cyclone低成本FPGA系列

3.2.1 Cyclone器件

3.2.2 CycloneⅡ器件

3.3 ACEX 1K器件

3.4 典型CPLD器件

3.4.1 MAXⅡ器件

3.4.2 MAX 7000器件

3.5 FPGA/CPLD的配置

3.5.1 CPLD器件的配置

3.5.2 FPGA器件的配置

習(xí)題3

第4章原理圖與宏功能模塊設(shè)計

4.1 QuartusⅡⅡ原理圖設(shè)計

4.1.1 半加器原理圖輸入

4.1.2 半加器編譯

4.1.3 半加器仿真

4.1.4 全加器設(shè)計與仿真

4.2 Quartus Ⅱ的優(yōu)化設(shè)置

4.2.1 Setting設(shè)置

4.2.2 分析與綜合設(shè)置

4.2.3 優(yōu)化布局布線

4.2.4 使用設(shè)計助手檢查設(shè)計可靠性

4.3 Quartus Ⅱ的時序分析

4.3.1 時序設(shè)置與分析

4.3.2 時序逼近

4.4宏功能模塊設(shè)計

4.4.1 Megafumctions庫

4.4.2 Maxplus2庫

4.4.3 Primitives庫

習(xí)題4

第5章VHDL設(shè)計輸入方式

5.1 Quartus Ⅱ的V10DL輸入設(shè)計

5.1.1 創(chuàng)建工程文件

5.!.2 編譯

5.1.3 仿真

5.2 Synplify Pro的VHDL輸入設(shè)計

5.2.1 用Synplify Pro綜合的過程

5.2.2 Synplify Pro與Quarttls Ⅱ的接口

5.3 Synplify的VHDL輸入設(shè)計

習(xí)題5

第6章VHDL結(jié)構(gòu)與要素

6.1 實體

6.1.1 類屬參數(shù)說明

6.1.2 端口說明

6.1.3 實體描述舉例

6.2 結(jié)構(gòu)體

6.2.1 結(jié)構(gòu)體的命名

6.2.2 結(jié)構(gòu)體信號定義語句

6.2.3 結(jié)構(gòu)體功能描述語句

6.2.4 結(jié)構(gòu)體描述方法

6.3 VHDL庫

6.3.1 庫的種類

6.3.2庫的用法

6.4 VHDL程序包

6.4.1 程序包組成和格式

6.4.2 VHDL標(biāo)準(zhǔn)程序包

6.5 配置

6.5.1 默認(rèn)配置

6.5.2 結(jié)構(gòu)體的配置

6.6 VHDL文字規(guī)則

6.6.1 標(biāo)識符

6.6.2 數(shù)字

6.6.3 字符串

6.7 VHDL數(shù)據(jù)類型

6.7.1 預(yù)定義數(shù)據(jù)類型

6.7.2 自定義數(shù)據(jù)類型

6.7.3 用戶自定義的子類型

6.7.4 數(shù)據(jù)類型的轉(zhuǎn)換

6.8 VHDL操作符

6.8.1 邏輯操作符

6.8.2 關(guān)系操作符

6.8.3 算術(shù)運算符

6.8.4 并置操作符

6.8.5 運算符重載

6.9 數(shù)據(jù)對象

6.9.1 常量

6.9.2 變量

習(xí)題6

第7章VHDL基本語句與基本設(shè)計

7.1 順序語句

7.1.1 賦值語句

7.1.2 IF語句

7.1.3 CASE語句

7.1.4 LOOP語句

7.1.5 NEXT語句

7.1.7 WAIT語句

7.1.8 子程序調(diào)用語句

7.2 并行語句

7.2.1 并行信號賦值語句

7.2.2 進程語句

7.2.3 并行過程調(diào)用語句

7.2.4 元器件例化語句

7.2.5 生成語句

7.3 VHDL組合邏輯電路設(shè)計

7.4 VHDL時序邏輯電路設(shè)計

7.4.1 觸發(fā)器

7.4.2 寄存器

7.4.3 計數(shù)器

7.4.4 分頻器

習(xí)題7

第8章VHDL設(shè)計進階

8.1 Ⅵ{DL行為描述方式

8.2 ⅧDL結(jié)構(gòu)化描述方式

8.3 Ⅵ{DLRTL描述方式

8.4 有限狀態(tài)機(FSM)設(shè)計

8.4.1 Moore和Mealy狀態(tài)機的選擇

8.4.2 有限狀態(tài)機的描述方式

8.4.3 有限狀態(tài)機的同步和復(fù)位

8.4.4 改進的.Moore型有限狀態(tài)機

8.4.5 小結(jié)

習(xí)題8

第9章數(shù)字接口實例及分析

9.1 ST-BUS總線接口設(shè)計

9.1.1 ST-BUS總線時序關(guān)系

9.1.2 ST-BUS總線接口實例

9.2 數(shù)字復(fù)接分接接口技術(shù)及設(shè)計

9.2.1 數(shù)字復(fù)接分接接口技術(shù)原理

9.2.2 同步數(shù)字復(fù)接分接接口設(shè)計實例

9.3 I2C接口設(shè)計

9.3.1 I2C總線工作原理

9.3.2 I2C總線接U設(shè)計實例

9.4 Uart控制器設(shè)計

9.4.1 Uart控制器原理

9.4.2 Uart控制器部分模塊代碼

習(xí)題9

第10章通信算法實例及分析

10.1 偽隨機序列的產(chǎn)生、檢測設(shè)計

10.1.1 m序列的產(chǎn)生

10.1.2 m序列的性質(zhì)

10.1.3 m序列發(fā)生器的VHDL設(shè)計

10.1.4 m序列檢測電路的VHDL設(shè)計

10.2 比特同步設(shè)計

10.2.1 鎖相功能的自同步法原理

10.2.2 鎖相比特同步的EDA實現(xiàn)方法

10.3 基帶差分編碼設(shè)計

10.3.1 PSK調(diào)制和差分編碼原理

10.3.2 PSK差分編碼設(shè)計

10.4 FIR濾波器設(shè)計

10.4.1 FIR濾波器簡介

10.4.2 使用MATLAB設(shè)計FIR濾波器

10.4.3 FIR濾波器的FPGA普通設(shè)計

10.4.4 FIR濾波器的并行FPGA優(yōu)化設(shè)計

習(xí)題10

附錄A EDA實驗系統(tǒng)簡介

參考文獻

……

EDA技術(shù)與WHDL設(shè)計造價信息

市場價 信息價 詢價
材料名稱 規(guī)格/型號 市場價
（除稅）		 工程建議價
（除稅）		 行情 品牌 單位 稅率 供應(yīng)商 報價日期
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施耐德

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設(shè)計系列蓋板 品種:分線盒蓋;類別:設(shè)計系列邊框;產(chǎn)品型號:MTN391943;產(chǎn)品組:EAT;庫存類型:IND;交貨期(工作日):40;最小起訂量(個) 查看價格 查看價格

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設(shè)計系列蓋板 品種:分線盒蓋;類別:設(shè)計系列邊框;產(chǎn)品型號:MTN391946;產(chǎn)品組:EAT;庫存類型:IND;交貨期(工作日):40;最小起訂量(個) 查看價格 查看價格

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材料名稱 規(guī)格/型號 除稅
信息價		 含稅
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材料名稱 規(guī)格/需求量 報價數(shù) 最新報價
（元）		 供應(yīng)商 報價地區(qū) 最新報價時間
技術(shù)與設(shè)計教學(xué)掛圖 11張,彩色,包括:實驗室制度、經(jīng)典技術(shù)設(shè)計賞析、經(jīng)典技術(shù)人物介紹等內(nèi)容.|1套 1 查看價格 中國教育企業(yè)股份有限公司 廣東   2019-06-21
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技術(shù)與設(shè)計教學(xué)掛圖 8張,彩色,內(nèi)容是常用設(shè)備和工具的使用方法以及注意事項.|1套 1 查看價格 中國教育企業(yè)股份有限公司 廣東   2019-06-21
流程與設(shè)計套件 拼插式結(jié)構(gòu),易于組裝和拆卸,可重復(fù)使用.由各種顆粒、軸承、軸、輪、齒輪、連接件與特殊件組成,用ABS材料制作.能搭建火中逃生、蓋房子、積木分揀流程的設(shè)計與優(yōu)化、積木分揀流程的優(yōu)化等活動項目.|28套 2 查看價格 廣州市熹尚科技設(shè)備有限公司 全國   2020-04-10
文物目錄檢索柜(目錄柜) 1、專業(yè)定制文物目錄檢索柜(目錄柜)2、規(guī)格:W800×D400×H1800|1個 1 查看價格 成都東凌辦公家具有限公司 四川   2019-10-31
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結(jié)構(gòu)與設(shè)計套件 詳見附件|1套 2 查看價格 湖南正海實驗設(shè)備有限公司 全國   2020-04-22
遙控小車設(shè)計與制作套件 拼插式結(jié)構(gòu),電子件均用ABS材料封裝..通過簡單電路的實例,知道電子控制系統(tǒng)的基本組成,能設(shè)計和安裝簡單的電子控制電路,能用集成電路設(shè)計和安裝簡單的遙控系統(tǒng),可完成的試驗項目是紅外遙控小車.|28套 1 查看價格 中國教育企業(yè)股份有限公司 廣東   2019-06-21

EDA技術(shù)與WHDL設(shè)計基本信息

作者:徐志軍 王金明 尹廷輝 等 合著者:王成華

定價:35.00元

出版社:電子工業(yè)出版社

頁碼:358 頁

出版日期:2009年

ISBN:9787121077555

開本:16

叢書名:普通高等教育"十一五"國家級規(guī)劃教材，電子信息與電氣學(xué)科規(guī)劃教材

EDA技術(shù)與WHDL設(shè)計目錄常見問題

  • 技術(shù)標(biāo)的目錄

    可以一樣可以不一樣，有時投標(biāo)文件會比招標(biāo)文件多，但內(nèi)容必須都是招標(biāo)文件要求提供的內(nèi)容。

  • 公差配合與技術(shù)測量的圖書目錄

    前言第一章　緒論第一節(jié)　互換性概述第二節(jié)　加工誤差和公差第三節(jié)　極限與配合標(biāo)準(zhǔn)第四節(jié)　技術(shù)測量概念第五節(jié)　本課程的性質(zhì)、任務(wù)與基本要求思考題與習(xí)題第二章　光滑孔、軸尺寸的公差與配合第一節(jié)　公差與配合的...

  • 建設(shè)工程技術(shù)與計量的目錄

    復(fù)習(xí)導(dǎo)言第一章 安裝工程材料考綱要求本章知識架構(gòu)考點與題型詳解考點一：金屬材料考點二：非金屬材料考點三：高分子材料考點四：復(fù)合材料考點五：型材、板材、管材和線材考點六：防腐、絕熱材料考點七：常用管件、...

EDA技術(shù)與WHDL設(shè)計目錄文獻

醫(yī)療技術(shù)目錄 醫(yī)療技術(shù)目錄

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大?。?span id="sggbe1s" class="single-tag-height">103KB

頁數(shù)： 15頁

評分： 4.5

成都長江醫(yī)院 關(guān)于調(diào)整各專業(yè)第一類醫(yī)療技術(shù)目錄的 通 知 各科室： 為進一步強化我院醫(yī)療技術(shù)分類管理，努力提高醫(yī)療服務(wù)水平，切實 保障醫(yī)療質(zhì)量及醫(yī)療安全，按照衛(wèi)生部《醫(yī)療技術(shù)臨床應(yīng)用管理辦法》要 求，現(xiàn)結(jié)合我院實際，調(diào)整制定醫(yī)院各專業(yè)一類醫(yī)療技術(shù)目錄，請認(rèn)真學(xué) 習(xí)貫徹，遵照執(zhí)行。 附件： 1、醫(yī)療技術(shù)分類 2、麻醉專業(yè)第一類醫(yī)療技術(shù)目錄 3、檢驗專業(yè)第一類醫(yī)療技術(shù)目錄 4、內(nèi)科專業(yè)第一類醫(yī)療技術(shù)目錄 5、口腔專業(yè)第一類醫(yī)療技術(shù)目錄 6、普外科專業(yè)第一類醫(yī)療技術(shù)目錄 7、骨科專業(yè)第一類醫(yī)療技術(shù)目錄 8、婦產(chǎn)科專業(yè)第一類醫(yī)療技術(shù)目錄 9、醫(yī)學(xué)影像第一類醫(yī)療技術(shù)目錄 10、耳鼻咽喉專業(yè)第一類醫(yī)療技術(shù)目錄 11、物理治療與康復(fù)專業(yè)第一類醫(yī)療技術(shù)目錄 12、皮膚專業(yè)第一類醫(yī)療技術(shù)目錄 成都長江醫(yī)院 2012 年 10月 12日 附件 1： 醫(yī)療技術(shù)分類 根

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封面與目錄 封面與目錄

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密級：內(nèi)部 山東魯能積成電子股份有限公司 人力資源體系 北大縱橫管理咨詢公司 二零零一年五月 目錄 員工手冊???????????????????????????? ..1 員工招聘制度 ????????????????????????? ....26 員工培訓(xùn)體系 ??????????????????????????3 5 績效考核體系 ??????????????????????????5 5 薪酬制度???????????????????????????? 85 員工職業(yè)生涯設(shè)計 ???????????????????????? 96 工作分析與職務(wù)說明書報告 ????????????????? ..??107 崗位評價報告 ???????????????????????? ..?199 職務(wù)評審及管理辦法 ????????????????????? ..?223

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第一篇 EDA技術(shù)基礎(chǔ)

第1章 概述

1.1 EDA技術(shù)的含義

1.2 EDA技術(shù)的主要內(nèi)容

1.3 EDA技術(shù)的特點及發(fā)展趨勢

第2章 可編程邏輯器件

2.1 概述

2.2 大規(guī)?？删幊踢壿嬈骷?/p>

2.3 Altera新型系列器件簡介

2.4 FPGA/CPLD器件的配置與編程

第3章 QuartusⅡ設(shè)計基礎(chǔ)

3.1 概述

3.2 QuartusⅡ的安裝與授權(quán)

3.3 QuartusⅡ設(shè)計流程

3.4 QuartusⅡ設(shè)計實例

第4章 硬件描述語言VHDL語法概要

4.1 概述

4.2 VHDL程序基本結(jié)構(gòu)

4.3 VHDL語言要素

4.4 VHDL的基本描述語句

4.5 子程序、程序包和配置

第5章 常用模塊電路的VHDL設(shè)計

5.1 常用組合邏輯電路的設(shè)計

5.2 時序邏輯電路的設(shè)計

5.3 狀態(tài)機的設(shè)計

5.4 存儲器的設(shè)計

第二篇 實戰(zhàn)訓(xùn)練

第6章 基礎(chǔ)訓(xùn)練

6.1 一位全加器原理圖輸入設(shè)計

6.2 譯碼顯示電路的設(shè)計

6.3 含異步清零和同步時鐘使能的4位加法計數(shù)器的設(shè)計

6.4 數(shù)控分頻器的設(shè)計

6.5 用狀態(tài)機實現(xiàn)序列檢測器的設(shè)計

6.6 簡易正弦信號發(fā)送器的設(shè)計

第7章 綜合訓(xùn)練

7.1 鍵盤輸入電路的設(shè)計

7.2 動態(tài)輸出4位十進制頻率計的設(shè)計

7.3 數(shù)字鐘的設(shè)計

7.4 DDS信號源的設(shè)計

7.5 基于Dsp Builder使用IP Core的FIR濾波器的設(shè)計

7.6 基于NiosⅡ的SD卡音樂播放器的實現(xiàn)

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《高等職業(yè)教育教學(xué)改革系列規(guī)劃教材·電子信息類:EDA技術(shù)與實踐教程(附光盤1張)》提供了參考授課計劃及自學(xué)建議;第1章概述了EDA技術(shù)的主要內(nèi)容;第2章簡要介紹了FPGA/CPLD的結(jié)構(gòu)與工作原理及其配置與編程方法;第3章介紹了Quartus Ⅱ設(shè)計流程及6個設(shè)計實例;第4章介紹了硬件描述語言VHDL語法概要;第5章用VHDL給出了常用單元電路的設(shè)計;第6章由淺入深精選了6個基礎(chǔ)訓(xùn)練項目;第7章精選了6個綜合訓(xùn)練項目。本教材提供的所有VHDL代碼均在Altera推廣型開發(fā)工具Quartus Ⅱ 9.0+SP1上綜合通過，部分例題給出了仿真結(jié)果，另附Quartus Ⅱ開發(fā)工具及相關(guān)資料DVD光盤一張。

《高等職業(yè)教育教學(xué)改革系列規(guī)劃教材·電子信息類:EDA技術(shù)與實踐教程(附光盤1張)》可作為各高職院校電子類、通信類及計算機類等相關(guān)專業(yè)二年級及以上學(xué)生的教材，也可作為電子技術(shù)工程技術(shù)人員的參考用書。

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《電子技術(shù)課程設(shè)計:EDA技術(shù)與應(yīng)用》目的和任務(wù)是通過實踐訓(xùn)練，要求學(xué)生初步掌握基于EDA技術(shù)的基本電路設(shè)計、常用硬件描述語言的使用、編程方法和仿真測試技術(shù)的應(yīng)用；學(xué)會使用QuartusⅡ工具軟件，掌握硬件電路設(shè)計軟件化的基本技能。課程立足于通過設(shè)計實驗加強學(xué)生的動手與實踐能力，提高學(xué)生分析問題、解決問題、應(yīng)用新知識的能力和創(chuàng)新精神。

全書理論聯(lián)系實際，根據(jù)順序漸進的學(xué)習(xí)規(guī)律，由淺入深地安排課程內(nèi)容。

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